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SC9689 利用 ADC 的寄存器中的快速檢測控制位，可編程閾值檢測器可以監(jiān)控輸入信號功率 。如果輸入信號電平超過可編程閾值，快速檢測指示器就會變?yōu)楦唠娖健Ｓ捎谠撻撝抵甘酒鞯难? 遲極短，因此用戶能夠快速調(diào)低系統(tǒng)增益，從而避免 ADC 輸入端出現(xiàn)超量程現(xiàn)象。除了快速檢 測輸出外，SC9689 還具有信號監(jiān)控能力。信號監(jiān)控模塊可提供 ADC 進(jìn)行數(shù)字化處理信號的其它 信息。 用戶可將 JESD204B 子類 1 的高速串行輸出設(shè)置為各種單通道、雙通道、四通道和八通道配 置，具體取決于接收邏輯器件的可接受通道速率。SYSREF±和 SYNCINB±輸入引腳支持多器件 同步。 SC9689 具有靈活的關(guān)斷選項(xiàng)，在需要時(shí)可以大幅降低功耗。所有這些特性均可通過三線式 串行端口接口(SPI)進(jìn)行編程。 SC9689 采用 196 引腳無鉛 BGA 封裝，額定溫度范圍為?40°C 至+85°C 環(huán)境溫度范圍。 請注意，在整篇數(shù)據(jù)手冊中，多功能引腳（如 FD_A/GPIO_A0）由整個引腳名稱或引腳的 單個功能表示；例如 FD_A 即表示僅與此功能相關(guān)。 

SC9689 是一款雙通道、14 位、2.0GSPS/2.6GSPS 模數(shù)轉(zhuǎn)換器(ADC)。該器件內(nèi)置片內(nèi)緩沖 器和采樣保持電路，專門針對低功耗、小尺寸和易用性而設(shè)計(jì)。該產(chǎn)品設(shè)計(jì)支持通信應(yīng)用，能夠 實(shí)現(xiàn)高達(dá) 5GHz 的寬帶寬模擬信號直接采樣。ADC 輸入的?3dB 帶寬為 9GHz。SC9689 針對寬輸 入帶寬、高采樣速率、出色的線性度和小封裝低功耗而優(yōu)化。 這款雙通道 ADC 內(nèi)核采用多級、差分流水線架構(gòu)，并集成了輸出糾錯邏輯。每個 ADC 均 具有寬帶寬輸入，支持用戶可選的各種輸入范圍。集成基準(zhǔn)電壓源可簡化設(shè)計(jì)考量。模擬輸入和 時(shí)鐘信號均為差分輸入信號。

 主要性能

 ? JESD204B(子類 1)編碼串行數(shù)字輸出 每通道支持高達(dá) 15 Gbps 的通道速率

 ? 2.6 GSPS 時(shí)每通道總功耗:1 W(默認(rèn)) 

? 0.975 V、1.8V 和 2.5 V 直流電源供電 

? 模擬輸入全功率帶寬：9 GHz (?3 dB) 

? 幅度檢測位支持實(shí)現(xiàn)高效 AGC 

? 串行端口控制 支持 100MHz SPI 寫入和 50MHz SPI 讀取 具有 2 和 4 分頻選項(xiàng)的整數(shù)時(shí)鐘 靈活的 JESD204B 線配置 

? 片內(nèi)擾動 

? 完全兼容 ADI 的 AD9689 應(yīng)用場合

? 分集多頻段、多模數(shù)字接收器 

? 3G/4G、TD-SCDMA、WCDMA、GSM、LTE、LTE-A

? 電子測試和測量系統(tǒng) 

? 相控陣?yán)走_(dá)與電子戰(zhàn)

 ? DOCSIS 3.0 CMTS 上行接收路徑

 ? HFC 數(shù)字反向路徑接收器 產(chǎn)品特色

 ? 9 GHz 的寬輸入?3 dB 帶寬支持約 5 GHz 的直接射頻(RF)信號采樣。 

? SPI 控制各種產(chǎn)品特性和功能，滿足特定 系統(tǒng)要求。

 ? 可編程的快速超范圍檢測和信號監(jiān)測。 

? 用于系統(tǒng)熱量管理的片內(nèi)溫度二極管。

 ? 196 球 BGA 封裝(12mmx12mm)無需散熱 器 

? 引腳、封裝、功能和存儲器映射兼容 SC9689 14 位、3.0GSPS、JESD204B 雙通 道 ADC

ADC 架構(gòu) SC9689 的由一個輸入緩沖流水線 ADC 組成。輸入緩沖器為模擬輸入信號提供端接阻抗。該 終端阻抗設(shè)置為 200Ω。模擬輸入終端的等效電路圖如上圖所示。輸入緩沖器針對高線性度、低 噪聲和低功耗進(jìn)行了優(yōu)化。 寬廣的帶寬 輸入緩沖器提供線性高輸入阻抗（便于驅(qū)動）并減少來自 ADC 的反沖。每個階段的量化輸 出在數(shù)字校正邏輯中被組合成最終的 14 位結(jié)果。流水線架構(gòu)允許第一階段使用新輸入進(jìn)行操作， 采樣發(fā)生在時(shí)鐘的上升沿。 模擬輸入注意事項(xiàng) SC9689的模擬輸入是一個差分緩沖器。緩沖器的內(nèi)部共模電壓為 1.35V。時(shí)鐘信號在采樣模 式和保持模式之間交替切換輸入電路。 可以在輸入端放置一個差分電容器或兩個單端電容器（或兩者的組合）以提供匹配的無源網(wǎng) 絡(luò)。這些電容器最終會形成一個低通濾波器，以限制不需要的寬帶噪聲。 通常，精確的前端網(wǎng)絡(luò)組件值取決于應(yīng)用程序。 圖 34 顯示了 100MHz 至 10GHz 頻率范圍內(nèi)模擬輸入的差分輸入回波損耗曲線。參考阻抗為 100 Ω。 

差分輸入配置 有多種驅(qū)動 SC9689 的方法，可以是主動的，也可以是被動的。通過差分驅(qū)動模擬輸入實(shí)現(xiàn) 最佳性能。 對于 SNR 和 SFDR 是關(guān)鍵參數(shù)的應(yīng)用，推薦使用差分變壓器耦合作為輸入配置（見圖 35 和 表 7），因?yàn)榇蠖鄶?shù)放大器的噪聲性能不足以實(shí)現(xiàn) SC9689 的真實(shí)性能。 對于中低頻，建議使用雙巴倫或雙變壓器網(wǎng)絡(luò)（參見圖 35 和表 7）以實(shí)現(xiàn) SC9689 的最佳性 能。對于更高的頻率在第二個或第三個奈奎斯特區(qū)，建議移除一些前端無源元件以確保性能良好 （見圖 35 和表 7）。